EPP模式500ksps数据采集接口

EPP的执行，当再次完成一次数据采样后，达到至少存在4个未读数据的条件，READ_EN重新变为有效，可供微机读取。
　　
　　为与微机接口，附加部分其它口线，其中RESET使CPLD全局复位，74ALS574的OE脚由微机控制输出是否为高阻，在程序设定数据端口作为输入使用前，保持该脚为高电平，使74ALS574输出为高阻态，虽然使用的是EPP模式的地址选通信号脚作控制，但程序中并无EPP模式的地址读写指令，此脚的变化直接由EPP端口的控制口（37AH）的D3位控制，另外一般D5位为读写方向控制，将该位置为高，使数据端口作为输入使用。SYN与RAMWR有固定（芯片编程时设定）的相位关系，作为数据采集的同步控制用，当选用MAX114芯片且配置为流水线模式（PipelinedMode）时，MAX114的WR及RD脚共同连接至SYN脚，此信号波形是与RAMWR同步下降但持续时间为500ns的负脉冲信号，由A/D芯片MAX114与SRAM及CPLD等器件可构成EPP模式下500ksps的连续数据采集接口。
　　
　　微机的数据接收是个环状循环体后台程序，频繁对端口的访问占据大量CPU时间片，为保证对用户操作的响应，应采取多线程方式的程序结构。微机
　　
　　
　　
　　软件部分采用Delphi程序设计语言，端口访问使用内嵌汇编语言，程序中开辟一块20-100M字节或更大的环型数据区，可根据实际需要考虑。
　　
　　
　　
　

《EPP模式500ksps数据采集接口(第4页)》