高性能DDS芯片AD9954及其应用

CS：片选端，低电平有效，允许多芯片共用I/O总线；

SCLK：I/O操作的串行数据时钟输入端；

SDIO：采用3线串口操作时，SDO为串行数据输入端，采用2线操作时，SDO为双向串行数据端。

DVDD_I/O；I/O电源，可以是1.8V或3.3V；

SYNC_IN：同步多片AD9954输入信号，使用时与主AD9954的SYNC_CLK的输出相连；

SYNC_CLK：时钟输出脚，为内部时钟的1/4，可用作外围硬件同步；

OSK：在编程操作时可用该脚来控制幅度与时间斜率，与SYNC_CLK同步；当OSK不能被编程时，此脚接DGND；

PS1和PS0：可用来选择4个RAM段控制字区中的一个。

3 AD9954的串行操作

在AD9954的串行操作中，指令字节用来指定读/写操作和寄存器地址。由于串行操作是在寄存器级别上发生的，因此串行端口控制器应能识别指令字节寄存器地址和自动产生适当的寄存器字节地址。在串行操作指令阶段和通信阶段，一般先传送指令阶段的指令字，指令阶段对应于SCLK的前8个上升沿，其对应的指令字（8比特）包含了以下信息：

其中R/W位用于决定指令字后的操作是读还是写，高电平为读出，低电平为写入；6、5位的电平高低与操作无关；4～0位则对应于A4～A0，表示操作串行寄存器地址，该地址信息同时包含了与该指令字所在指令段对应的通信段的传送字节数。指令阶段后接着是通讯阶段，传送对应于字节数的几个通信周期。

通信周期完成后，AD9954的串口控制器即认为接下来的8个SCLK的上升沿对应的是下一个通信周期的指令字。IOSYNC引脚为高时将立即终止当前的通信周期，而当IOSYNC引脚状态回到低电平时，AD9954串口控制器即认为接下来的8个系统时钟的上升沿对应的是下一个通信周期的指令字，从而保持通信的同步。

    AD9954的串行操作有两种数据传送方式，即从最高位开始传送和从最低位开始传送，这是由控制寄存器0的第8位来决定的。默认状态为低电平，此时先传送最高位，若为高电平则先传送最低位。串行操作的读/写时序如图3所示。

4 AD9954的RAM

AD9954内部的1024×32静态RAM具有双向单一入口，对它进行的读/写操作不能同时进行，写操作优先。RAM的使能位是CFR<31>（控制功能寄存器31位），此位为低时，对RAM的操作只能通过串行端口；此位为高且CFR<30>为逻辑0时，RAM的输出为相位累加器的输入，此时给芯片提供的是频率转换字；此位为高且CFR<30>为逻辑1时，RAM的输出可作为相位偏移加法器的输入给芯片提供相位偏移控制字。写RAM的操作首先通过控制PS1、SP0来选择RAM段。然后再对相应的RAM控制寄存器写RAM操作的地址变化率、起始地址、终止地址、模式控制和停留方式位。RAM段控制寄存器的5、6、7位可用来指示RAM操作的5种模式，即直接转换模式、上斜坡模式、双向斜变模式、连续双向斜变模式和连续循环模式。其中连续循环模式是使能RAM，RAM模式控制字为100，这种模式可提供自动、连续、单向的扫频，地址发生器从起始地址开始，当其增加到终止地址后会自动回到起始地址重新开始下次循环。

RAM段控制寄存器的39～24位可定义RAM控制器在每个地址停留的SYNC_CLK的周期数，取值范围是1～65535；9、8、23～16位用于定义10位终止地址；3～0、15～10位则用于定义10位起始地址。